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標(biāo)題: 求指導(dǎo) 2023電賽H題-兩個(gè)信號(hào)經(jīng)加法器后如何再分離出(全程自動(dòng)) [打印本頁(yè)]

作者: y1954095816 時(shí)間: 2023-8-2 12:32
標(biāo)題: 求指導(dǎo) 2023電賽H題-兩個(gè)信號(hào)經(jīng)加法器后如何再分離出(全程自動(dòng))
求思路謝謝大家

作者: liyonghua111 時(shí)間: 2023-8-2 14:44
如果將兩個(gè)信號(hào)通過(guò)加法器進(jìn)行混合，通常是不可逆的。因此，在全程自動(dòng)的情況下，無(wú)法直接從混合信號(hào)中分離出原始的兩個(gè)信號(hào)。

然而，如果在混合之前已經(jīng)對(duì)兩個(gè)信號(hào)進(jìn)行了特定的處理或編碼，那么可能可以通過(guò)相應(yīng)的解碼或逆處理來(lái)恢復(fù)原始信號(hào)。

例如，如果在混合之前對(duì)每個(gè)信號(hào)進(jìn)行了頻率調(diào)制或幅度調(diào)制，那么可以使用相應(yīng)的解調(diào)器或解調(diào)算法來(lái)還原原始信號(hào)。

另一種方法是使用多路復(fù)用技術(shù)，在混合之前對(duì)兩個(gè)信號(hào)進(jìn)行時(shí)分復(fù)用或頻分復(fù)用，并使用相應(yīng)的解復(fù)用器來(lái)分離信號(hào)。

總之，在全程自動(dòng)的情況下，如果沒(méi)有進(jìn)行特殊處理或編碼，通常是無(wú)法從混合信號(hào)中完全自動(dòng)地分離出原始的兩個(gè)信號(hào)的。
為了設(shè)計(jì)和制作信號(hào)分離裝置，您需要考慮以下步驟：

設(shè)計(jì)一個(gè)雙路輸出信號(hào)源，能生頻率范圍在20kHz至100kHz之間的兩個(gè)周期信號(hào)A和B。確保信號(hào)A的頻率小于信號(hào)B，并且它們的峰峰值都為1V。

使用增益為1的加法器將信號(hào)A和B相加，生成混合信號(hào)C。

設(shè)計(jì)一個(gè)分離電路，可以將混合信號(hào)C分離出信號(hào)A'和B'。這個(gè)分離電路需要能夠?qū)崿F(xiàn)無(wú)失真地分離信號(hào)，并且保持A'和A、B'和B的波形連續(xù)穩(wěn)定地同頻顯示在示波器上。

在設(shè)計(jì)分離電路時(shí)，您可以考慮使用濾波器來(lái)分離信號(hào)。根據(jù)信號(hào)A和B的頻率范圍，您可以選擇合適的濾波器類(lèi)型（例如低通濾波器或帶通濾波器）來(lái)實(shí)現(xiàn)信號(hào)的分離。此外，還需要確保分離電路具有足夠的帶寬，以便能夠傳遞信號(hào)A和B的所有頻率成分。

最后，進(jìn)行電路布局和制作，確保電路連接正確，并按照設(shè)計(jì)要求調(diào)整增益和濾波器參數(shù)，以達(dá)到所需的信號(hào)分離效果。

請(qǐng)注意，在實(shí)際制作過(guò)程中可能會(huì)遇到一些挑戰(zhàn)和調(diào)試的問(wèn)題。因此，建議您在制作之前對(duì)電路進(jìn)行仿真和測(cè)試，以確保設(shè)計(jì)的正確性和性能。

作者: dandan-tcb 時(shí)間: 2023-8-2 15:48
看了電賽的題目，題目要求的頻率范圍是5k到100k。。如果圖方便，那么可以到ADI官網(wǎng)找滿(mǎn)足要求的數(shù)字濾波器芯片。信號(hào)經(jīng)過(guò)兩個(gè)濾波器分離。

作者: dandan-tcb 時(shí)間: 2023-8-2 15:51
如果會(huì)玩FPGA，那我更建議你用FPGA做數(shù)字濾波。整體的架構(gòu)是：高速ADC+FPGA+高速DAC。。

作者: 風(fēng)158 時(shí)間: 2023-8-2 19:51

如果是兩個(gè)不同頻率的連續(xù)波，可以直接混合，再用調(diào)諧濾波或傅里葉變換分離。
如果是兩個(gè)信號(hào)同一個(gè)頻率，可參考一下立體聲的調(diào)制解調(diào)。

作者: Hephaestus 時(shí)間: 2023-8-2 23:04

風(fēng)158 發(fā)表于 2023-8-2 19:51
如果是兩個(gè)不同頻率的連續(xù)波，可以直接混合，再用調(diào)諧濾波或傅里葉變換分離。
如果是兩個(gè)信號(hào)同一個(gè)頻率 ...

兩個(gè)信號(hào)同頻經(jīng)過(guò)加法器后，兩個(gè)信號(hào)的相位和幅值都會(huì)丟失，不可能恢復(fù)回來(lái)，如果你念過(guò)高中，用三角函數(shù)和差化積公式很容易證明。

作者: wyh6666 時(shí)間: 2023-8-3 07:51
ADC+FFT+DDS/DAC

作者: yzwzfyz 時(shí)間: 2023-8-3 13:57
1、先研究信號(hào)的特點(diǎn)與區(qū)別。
2、根據(jù)兩者的區(qū)別與特點(diǎn)，進(jìn)行分離。
無(wú)有統(tǒng)一的方式。

作者: 風(fēng)158 時(shí)間: 2023-8-3 22:00

Hephaestus 發(fā)表于 2023-8-2 23:04
兩個(gè)信號(hào)同頻經(jīng)過(guò)加法器后，兩個(gè)信號(hào)的相位和幅值都會(huì)丟失，不可能恢復(fù)回來(lái)，如果你念過(guò)高中，用三角函數(shù) ...

請(qǐng)百度立體聲調(diào)制解調(diào)原理。兩個(gè)信號(hào)同頻當(dāng)然不能直接相加，必須處理后再發(fā)送。要么頻分，要么時(shí)分。

作者: gao111 時(shí)間: 2023-8-4 13:50

wyh6666 發(fā)表于 2023-8-3 07:51
ADC+FFT+DDS/DAC

fft怎么實(shí)時(shí)給dds

作者: cai_FPGA 時(shí)間: 2023-10-16 14:49

dandan-tcb 發(fā)表于 2023-8-2 15:51
如果會(huì)玩FPGA，那我更建議你用FPGA做數(shù)字濾波。整體的架構(gòu)是：高速ADC+FPGA+高速DAC。。

老哥fpga數(shù)字濾波這塊有思路指導(dǎo)一下嘛

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