四段你有過比較重大的流片失敗經歷了，你知道要做好一個電路，需要精益求精，需要戰戰兢兢的仔細檢查每一個細節。你發現在設計過程中有很多不曾設想過的問題，想要做好電路需要完整的把握每一個方面。于是你開始系統地重新學習在大學畢業時已經賣掉的課本。你把能能找到的相關資料都仔細的看了一邊，希望能從中找到一些更有啟發性的想法。你已經清楚地知道了你需要達到的電路指標和性能，你也知道了電路設計本質上是需要做很多合理的折中。可你搞不清這個“合理”是怎么確定的，不同指標之間的折中如何選擇才好。你覺得要設計出一個適當的能夠正常工作的電路真的太難了，你不相信在這個世界上有人可以做到他們宣稱的那么好，因為聰明如你都覺得面對如此紛雜的選擇束手無策，他們怎么可能做得到？這個階段中，你覺得spice功能還是太有限了，而且經常對著"time step too small"的出錯信息發呆，偶爾情況下你還會創造出巨大的仿真文件讓所有人和電腦崩潰。