1. Protel 原理圖到Cadence Design Systems, Inc. Capture CIS
在Protel原理圖的轉(zhuǎn)化上我們可以利用Protel DXP SP2的新功能來實現(xiàn)。通過這一功能我們可以直接將Protel的原理圖轉(zhuǎn)化到Capture CIS中。
1) Protel DXP在輸出Capture DSN文件的時候,沒有輸出封裝信息,在Capture中我們會看到所以元件的PCB Footprint屬性都是空的。這就需要我們手工為元件添加封裝信息,這也是整個轉(zhuǎn)化過程中最耗時的工作。在添加封裝信息時要注意保持與Protel PCB設(shè)計中的封裝一致性,以及Cadence在封裝命名上的限制。我們在Capture中給元件添加封裝信息時,要考慮到這些命名的改變。麥斯艾姆(massembly)貼片知識課堂,用通俗的文字介紹專業(yè)貼片知識。麥斯艾姆科技,全國首家PCB(麥斯艾姆知識課堂)樣板打板,元器件代采購,及貼片的一站式服務(wù)提供者!
基本上注意到上述幾點,借助Protel DXP,可以將Protel的原理圖轉(zhuǎn)化到Capture中。進一步推廣,這也為現(xiàn)有的Protel原理圖符號庫轉(zhuǎn)化到Capture提供了一個途徑。
長期使用Protel作PCB設(shè)計,我們總會積累一個龐大的經(jīng)過實踐檢驗的Protel封裝庫,當設(shè)計平臺轉(zhuǎn)換時,如何保留這個封裝庫總是令人頭痛。這里,我們將使用Orcad Layout,和免費的Cadence工具Layout2Allegro來完成這項工作。
有了前面兩步的基礎(chǔ),我們就可以進行Protel PCB到Allegro的轉(zhuǎn)化了。這個轉(zhuǎn)化過程更確切的說是一個設(shè)計重現(xiàn)過程,我們將在Allegro中重現(xiàn)Protel PCB的布局和布線。
2) 首先,我們要重現(xiàn)器件布局。在Protel中輸出Place & Pick文件,這個文件中包含了完整的器件位置,旋轉(zhuǎn)角度和放置層的信息。我們通過簡單的手工修改,就可以將它轉(zhuǎn)化為Allegro的Placement文件。在Allegro中導(dǎo)入這個Placement文件,我們就可以得到布局了。
4) Protel中的層命名與Allegro中有所區(qū)別,要注意使用文本編輯器作適當?shù)男薷摹?/div>
5) 注意在Specctra中查看過孔的定義,并添加到Allegro的規(guī)則中。在allegro中定義過孔從Specctra中輸出布線信息,可以使用session, wires, 和route文件,建議使用route文件,然后將布線信息導(dǎo)入到我們以及重現(xiàn)布局的Allegro PCB中,就完成了我們從Protel PCB到Allegro BRD的轉(zhuǎn)化工作。
Protel到Allegro轉(zhuǎn)化的方法
在這過程當中碰到的問題大致可分為兩種:一是設(shè)計不很復(fù)雜,設(shè)計師只想借助Cadence CCT的強大自動布線功能完成布線工作;二是設(shè)計復(fù)雜,設(shè)計師需要借助信噪分析工具來對設(shè)計進行信噪仿真,設(shè)置線網(wǎng)的布線拓撲結(jié)構(gòu)等工作。
對于第一種情況,要做的轉(zhuǎn)化工作比較簡單,可以使用Protel或Cadence提供的Protel到CCT的轉(zhuǎn)換工具來完成這一工作。對于第二種情況,要做的工作相對復(fù)雜一些,下面將這種轉(zhuǎn)化的方法作一簡單的介紹。
Cadence信噪分析工具的分析對象是Cadence Allegro的brd文件,而Allegro可以讀入合乎其要求的第三方網(wǎng)表,Protel輸出的Telexis格式的網(wǎng)表滿足Allegro對第三方網(wǎng)表的要求,這樣就可以將Protel文件注入Allegro。
首先,Allegro第三方網(wǎng)表在$PACKAGE段不允許有“.”;其次,在Protel中,我們用BasName[0:N]的形式表示總線,用BasName[x]表示總線中的一根信號,Allegro第三方網(wǎng)表中總線中的一根信號的表示形式為Bas NameX,讀者可以通過直接修改Protel輸出的Telexis網(wǎng)表的方法解決這些問題。
Allegro在注入第三方網(wǎng)表時還需要每種類型器件的設(shè)備描述文件Device.txt文件,它的格式如下:
Package: package type
Class: classtype
Pincount: total pinnumber
Pinused: ...
其中常用的是PACKAGE,CLASS,PINCOUNT這幾項。PACKAGE描述了器件的封裝,但Allegro在注入網(wǎng)表時會用網(wǎng)表中的PACKAGE項而忽略設(shè)備描述文件中的這一項。CLASS確定器件的類型,以便信噪分折,Cadence將器件分為IC,IO,DISCRETE三類。PINCOUNT說明器件的管腳數(shù)目。對于大多數(shù)器件,Device.txt文件中包含有這三項就足夠了。
有了第三方網(wǎng)表和設(shè)備描述文件,我們就可以將Protel中原理圖設(shè)計以網(wǎng)表的形式代入到Cadence PCB設(shè)計軟件中,接下來,設(shè)計師就可以借助Cadence PCB軟件在高速高密度PCB設(shè)計方面的強大功能完成自己的設(shè)計。
如果已經(jīng)在Protel作了PCB布局的工作,Allegro的script功能可以將Protcl中的布局在Allegro中重現(xiàn)出來。在Protel中,設(shè)計師可以輸出一個Place & Pick文件,這個文件中包含了每個器件的位置、旋轉(zhuǎn)角度和放在PCB頂層還是底層等信息,可以通過這個文件很方便的生成一個Allegro的script文件,在Allegro中執(zhí)行這個script就能夠重現(xiàn)Protel中的布局了,下面給出了完成Place & Pick文件到Allegro Script文件轉(zhuǎn)化的C++代碼,筆者使用這段代碼,僅用了數(shù)分鐘就將一個用戶有800多個器件的PCB板布局在Allegro重現(xiàn)出來。
FILE *fp1, *fp2;
::AfxMessageBox("hello");
fp1=fopen("pick.txt", "rt");
if (fp1==NULL) ::AfxMessageBox("Can not open the file!!!");
fp2=fopen("place.txt","wt");
if (fp2==NULL) ::AfxMessageBox("Can not create the file!!!");
char refdes[5], Pattern[5];
float midx,midy,refx,refy,padx,pady,rotation;
char tb[1];
char tmp='"';
fprintf(fp2,"%s\n", "# Allegro script");
fprintf(fp2,"%s\n", "version 13.6");
fprintf(fp2,"%s\n", "place refdes");
while (!feof(fp1)) {
fscanf(fp1,"%s", refdes);
fscanf(fp1,"%s", Pattern);
fscanf(fp1,"%f", &midx);
fscanf(fp1,"%f", &midy);
fscanf(fp1,"%f", &refx);
fscanf(fp1,"%f", &refy);
fscanf(fp1,"%f", &padx);
fscanf(fp1,"%f", &pady);
fscanf(fp1,"%s", tb);
fscanf(fp1,"%f", &rotation);
fprintf(fp2, "fillin %c%s%c \n",tmp,refdes,tmp);
if (rotation!=0) {
fprintf(fp2, "rotate\n");
fprintf(fp2, "iangle %f\n", rotation);
};
char yy=tb[0];
if (yy!='T') fprintf(fp2, "pop mirror\n");
fprintf(fp2, "pick %f %f \n", padx,pady);
fprintf(fp2, "next \n");
};
fprintf(fp2, "done");
fclose(fp1);
fclose(fp2);
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