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標(biāo)題: 基于DDS任意波形信號(hào)發(fā)生器的FPGA設(shè)計(jì) [打印本頁(yè)]
作者: 朱國(guó)金    時(shí)間: 2017-5-16 12:46
標(biāo)題: 基于DDS任意波形信號(hào)發(fā)生器的FPGA設(shè)計(jì)
  直接數(shù)字頻率合成（DDS）是二十世紀(jì)七十年代初提出的一種全數(shù)字的頻率合成技術(shù)，其查表合成變形的方法可以滿(mǎn)足產(chǎn)生任意波形的要求。隨著現(xiàn)場(chǎng)可編程門(mén)陣列（FPGA）的快速發(fā)展，其具有高速度、集成度高和可實(shí)現(xiàn)大容量存儲(chǔ)功能的特性，從而有效的實(shí)現(xiàn)了DDS技術(shù)，提高了技術(shù)同時(shí)降低了成本。

  本設(shè)計(jì)使用Altera公司出廠(chǎng)的暴風(fēng)四代EP4CE6E22C8開(kāi)發(fā)板作為產(chǎn)生波形數(shù)據(jù)的主芯片，充分利用該芯片的超大集成性和快速性。論文首先對(duì)DDS的基本原理和輸出信號(hào)的頻譜特性進(jìn)行了理論分析，可以通過(guò)增大有效波形的儲(chǔ)存容量、修改頻率控制字來(lái)改變輸出頻率等方法來(lái)合成信號(hào)頻譜純度。其次，本文利用Altera的設(shè)計(jì)工具Quartus ii 15.1.0 結(jié)合Verilg-HDL語(yǔ)言來(lái)設(shè)計(jì)硬件電路。在設(shè)計(jì)的過(guò)程中經(jīng)研究發(fā)現(xiàn)采用硬件編程的方法設(shè)計(jì)，很好的克服了在設(shè)計(jì)上出現(xiàn)的芯片和控制接口的難題。第三步，通過(guò)時(shí)鐘信號(hào)驅(qū)動(dòng)開(kāi)發(fā)板，在經(jīng)動(dòng)態(tài)掃描過(guò)程把硬件電路輸出的信號(hào)進(jìn)PWM輸出顯示在四位數(shù)碼管上。本文既做仿真也做實(shí)物，仿真主要是通過(guò)Quartus ii 自帶的仿真器進(jìn)行仿真。

  通過(guò)示波器測(cè)量表明，由FPGA可設(shè)計(jì)出簡(jiǎn)易的信號(hào)發(fā)生器，其可以輸出頻率在100KHz以?xún)?nèi)且頻率可調(diào)的三角波、正弦波和方波三種波形，經(jīng)再三調(diào)試設(shè)定的頻率值與輸出頻率值誤差小于1Hz。



完整論文下載（word格式 可編輯）：
基于DDS的簡(jiǎn)易波形發(fā)生器的設(shè)計(jì).zip (639.73 KB, 下載次數(shù): 130)


作者: jcwangzi    時(shí)間: 2018-8-12 07:26
good data for me
作者: mumuxils    時(shí)間: 2018-10-16 19:03
很有用嗎
作者: mumuxils    時(shí)間: 2018-10-16 19:03
感謝樓主



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