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總線與寄存器實(shí)驗(yàn)報(bào)告

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ID:426799 發(fā)表于 2018-11-15 00:00 | 顯示全部樓層 |閱讀模式

實(shí)驗(yàn)一  總線與寄存器


一、實(shí)驗(yàn)?zāi)康?/strong>

1、熟悉實(shí)驗(yàn)軟件環(huán)境;

2、掌握總線以及數(shù)據(jù)通路的概念及傳輸特性;

3、理解鎖存器、通用寄存器及移位寄存器的功能。


二、實(shí)驗(yàn)內(nèi)容

1、根據(jù)已搭建好的8位數(shù)據(jù)通路,熟悉總線連接的方法,理解74LS244芯片的作用,理解各相關(guān)信號(hào)在數(shù)據(jù)傳輸過程中起的作用;

2、通過撥碼開關(guān)置數(shù),將數(shù)據(jù)傳送到各寄存器,將寄存器中數(shù)據(jù)顯示出來,熟悉常用的寄存器。


三、實(shí)驗(yàn)器件

1、D觸發(fā)器(74LS74、74LS175)、三態(tài)緩沖器(74LS244)。

2、寄存器(74LS273、74LS374 )和移位寄存器(74LS194)


四、實(shí)驗(yàn)原理

(見實(shí)驗(yàn)指導(dǎo)書)


五、實(shí)驗(yàn)步驟

注意:實(shí)驗(yàn)過程中應(yīng)觀察總線上及芯片引腳上顯示的數(shù)據(jù)的變化情況,理解數(shù)據(jù)傳送的過程和寄存器存數(shù),從寄存器讀數(shù)的原理。


實(shí)驗(yàn)(1)撥碼開關(guān)輸入數(shù)據(jù)至總線
====1;手動(dòng)操作總線DIN上的撥碼開關(guān),在總線DIN上置位數(shù)據(jù)0x55,緩沖器244阻斷。比較總線DIN與BUS狀態(tài)的異同。
=0,比較總線DIN與BUS狀態(tài)的異同,記錄BUS總線的數(shù)據(jù):

BUS_7

BUS_6

BUS_5

BUS_4

BUS_3

BUS_2

BUS_1

BUS_0

BUS總線

0

1

0

1

0

1

0

1

AA



實(shí)驗(yàn)(2D觸發(fā)器數(shù)據(jù)鎖存實(shí)驗(yàn)
=0,===1;通過撥碼開關(guān)改變74LS74的D端(即BUS總線的BUS_0)的狀態(tài),按照下表置位74LS74的端、端,觀察并記錄CLK端上升沿 、下降沿跳變時(shí)刻Q端、端的狀態(tài),填觀測(cè)結(jié)果于表中。

  

CLK

D

Qn

Qn+1

n+1

0   1

×

×

0

1

0

1

1

0

1   0

×

×

0

0

1

1

0

1

1   1

0

0

0

1

1

0

1

1   1

1

0

1

0

1

1

0

1   1

0(1)

×

0

1

0

1

1

0



●74LS175的三態(tài)門244阻斷(=1),撥碼開關(guān)置位BUS總線數(shù)據(jù),使74LS175的D端分別接高,低電平,觀察并記錄當(dāng)CLK上升沿 、下降沿跳變時(shí)Q端、端的狀態(tài)。
●觀察74LS175的Q端、端和74LS74的Q端、端的異同,觀察當(dāng)74LS175的MR端置0后(=0),輸出Q端、端的變化。
都是高電平:1,0,低電平:0,1。當(dāng)74LS175的MR端置0后(=0) 高電平:1,0,變?yōu)?,1;低電平:0,1還是0,1.


實(shí)驗(yàn)(3)通用寄存器實(shí)驗(yàn)
=0,===1;操作撥碼開關(guān)輸入數(shù)據(jù)0xAA 到總線,觀測(cè)此時(shí)74LS374和74LS273輸出6端QX的各自狀態(tài)。
狀態(tài):
74LS374:10101010     74LS273:00000000
●74LS374的CLK端R0_CLK上升沿跳變把總線上的0xAA數(shù)據(jù)存入R0寄存器(74LS374)。
●撥碼開關(guān)的三態(tài)門244阻斷(=1),觀察此時(shí)總線BUS上的狀態(tài)。

總線BUS被阻斷無信號(hào)

●74LS374的輸出選通(=0),觀測(cè)總線BUS的狀態(tài)。
數(shù)據(jù)從無變?yōu)閛xAA

●74LS273的CLK端DR_CLK上升沿跳變把總線上的0xAA數(shù)據(jù)存入DR寄存器(74LS273)。觀察74LS374和74LS273輸出端QX的各自狀態(tài)。
74Ls374:10101010
74LS273:10101010

實(shí)驗(yàn)(4)移位寄存器實(shí)驗(yàn)

=0,===1;通過撥碼開關(guān)送入總線BUS任意八位二進(jìn)制數(shù),賦值74LS194的輸入端D0D1D2D3。分別設(shè)置74LS194的MR端、S1端、S0 端、SL端、SR端,觀察CLK端上升沿 、下降沿跳變時(shí)刻輸出端Q0Q1Q2Q3的狀態(tài),驗(yàn)證74LS194的功能。功能表如下,其中“×”號(hào)表示輸入任意值。觀察電路中兩個(gè)74LS194聯(lián)合構(gòu)成8位移位器的方法,及移位效果。

74LS194功能表

  • 實(shí)驗(yàn)總結(jié):
  • DIN總線中連接著撥碼開關(guān),在bus總線中含有著三態(tài)門

總線上的數(shù)據(jù)由DIN總線上的撥碼開關(guān)控制

在DIN總線上傳輸數(shù)據(jù)到bus總線,bus總線傳輸數(shù)據(jù)到顯示屏上

同:DIN總線上的數(shù)據(jù)與bus上的數(shù)據(jù)都是相同的

異:一個(gè)作為輸入,一個(gè)作為傳輸

2觸發(fā)器是時(shí)鐘上升沿(↑)觸發(fā),瞬間保存數(shù)據(jù);鎖存器是時(shí)鐘高電平期間輸出跟隨輸入變化,下降沿(↓)保存數(shù)據(jù)。二者就是觸發(fā)方式不同,適用于不同的場(chǎng)合。如 CPU 復(fù)用總線的地址鎖存就是用鎖存器。


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ID:433654 發(fā)表于 2018-11-26 19:04 | 顯示全部樓層
樓主是真的牛逼
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ID:433654 發(fā)表于 2018-11-26 19:17 | 顯示全部樓層
辛苦了 很好
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ID:537437 發(fā)表于 2019-5-13 21:34 | 顯示全部樓層
感謝二,派上大用場(chǎng)了
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ID:543682 發(fā)表于 2019-5-21 12:46 | 顯示全部樓層
謝謝樓主
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ID:579507 發(fā)表于 2019-7-7 19:16 | 顯示全部樓層
謝謝樓豬
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ID:779931 發(fā)表于 2020-6-16 06:06 | 顯示全部樓層
謝謝樓豬
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ID:789666 發(fā)表于 2020-6-25 18:22 | 顯示全部樓層
感謝樓主
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