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PCB 設計注意事項系列 5:時鐘和網口

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ID:165052 發表于 2017-5-3 17:49 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
CLK 分類:

1) HostClock:MCH_BCLK(差分信號)和 CPU_BCLK(差分信號),166/200MHZ

2) PCI_CLK:PCI_CLK【5:0】,33MHZ

3) REFCLK:14MHZ

4) USBCLK:48MHZ

5) DOTCLK:96MHZ

6) SRCCLK:(serial referenceclock)100MHZ

下載:
PCB設計注意事項系列5:時鐘和網口.pdf (499.59 KB, 下載次數: 8)


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