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MATLAB+VHDL脈沖成型濾波器的設(shè)計 附代碼

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發(fā)布時間: 2019-4-17 14:01

正文摘要:

文中應用了MATLAB和VHDL聯(lián)合設(shè)計,提出基于電路分割技術(shù)實現(xiàn)通信系統(tǒng)發(fā)送端根升余弦波形成型濾波器查表法的FPGA結(jié)構(gòu),節(jié)省了ROM單元,討論其ROM初始化時波形數(shù)據(jù)的組織方法,完成了該結(jié)構(gòu)VHDL實現(xiàn),最后給出使用查找 ...

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ID:630326 發(fā)表于 2019-10-26 10:37
IKnown 發(fā)表于 2019-4-17 14:02
第一次發(fā)帖 有不好的地方請大家見諒

您好,F(xiàn)PGA小白一個。想照著您這個流程順序走一遍,但無奈基礎(chǔ)太弱,作者能不能再具體一些啊,如何具體的matlab設(shè)計步驟以及后來對比分析,能讓我們這種小白完全順著來一遍
ID:514491 發(fā)表于 2019-4-17 14:02
第一次發(fā)帖 有不好的地方請大家見諒

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